DDR3接口/Gbps高速差分SIPI設計培訓課程

2019-03-15  by:CAE仿真在線  來源:互聯網

課程簡介

DDR3接口工作不穩定、系統死機、數據讀寫頻繁出錯?!

為什么?該如何解決?怎樣設計才能一板成功?

5Gbps/10Gbps/28Gbps等高速差分接口,誤碼率高、鏈路工作不穩定?!

問題出在哪里?如何解決?怎樣設計才能一板成功?

本課程帶來的是:解決故障的清晰思路、一板成功的設計秘訣!

在長期為客戶解決問題并整改的過程中,我們發現,DDR3接口、Gbps高速差分接口是出問題極多的兩個部分,大量的整改項目都和這兩個接口的問題有關。

在幫助客戶解決故障過程中,我們發現了大量問題:整體設計不合理、關鍵點控制不到位、細節優化不到位......

為了提高一板成功率,基于對故障成因的深度分析,本課程對這兩種接口的信號完整性及電源完整性設計進行了精心梳理,內容涵蓋:SIPI設計的關鍵點、優化設計方法、必須注意的細節問題、怎樣做好設計控制、必要知識點等等。

課程收益

思路清晰地解決故障。系統的優化設計方法,大幅度提升一板成功率!

課程對象

從事硬件開發部門主管、硬件項目負責人、SI工程師、硬件開發工程師、PCB設計工程師、測試工程師、系統工程師、質量管理人員等。

課程大綱

《DDR3接口/Gbps高速差分SIPI設計》

第一部分:DDR3接口SIPI設計

1、DDR3 接口 SI/PI 設計內容

• DDR3 接口介紹

• DDR3 接口信號電源要求

• DDR3 接口SI/PI 設計包含哪些內容?

• 如何評價DDR接口信號質量?

• 導致眼圖惡化的因素

• 時序分析ABC

• 影響時序的因素

• Timing Budget 示例

2、DQ/DQS 信號組

• 了解SSTL的脾氣

• ODT和ZQcalibration

• 走線阻抗:50歐? 45歐?40歐? …………

• 間距控制:1.5X? 2X ? 2.5X ? …………

• 如何優化Ron、Z0、ODT組合

• 影響時序的因素分析

• 扇出長度問題

• 走線中途過孔的處理

• 怎樣規劃層疊和參考平面?

3、ADDR/CMD/CNTL_CLOCK信號組

• 常用拓撲結構及端接

• 摸透Fly-by 結構的脾氣

• 鏈中容性負載的影響

• 容性負載補償

• VTT 上拉電阻的選擇

• 主干線長度、DDR區域分段長度、尾巴長度等的影響

• 驅動器封裝引起的波形變化

• DDR芯片封裝引起的信號惡化

• DDR芯片扇出過孔的影響、扇出長度的影響

• Fly-by 結構中不同位置的眼圖特點

• Fly-By結構綜合優化

• Fly-By結構的等長設置

• Timing Budget: 示例

• 影響jitter的因素分析

• T拓撲與端接

4、DDR3接口電源設計

• VDD/VDDQ電源設計

• VTT電源設計

• VREF電源設計

5、信號質量及時序優化要點

• 如何選擇阻抗

• 層疊設置必須注意的問題

• Date lane優化要點

• ADDR/CMD/CNTL/CLK優化要點

• DDR3接口布線優化要點

• VDD/VDDQ電源設計要點

• VTT電源設計要點

• VREF電源設計要點

6、DDR3 接口仿真方法

• 仿真設置關鍵點

• 如何解讀仿真結果

• 信號質量仿真、演示

• 眼圖質量仿真、演示

• 時序仿真、演示

第二部分:Gbps高速差分SIPI設計

1、高速差分設計8個關鍵控制點

• 高速差分互連系統結構

• 眼圖關鍵特征參數解讀

• 高速差分設計8個關鍵控制點

2、S參數及TDR

• 理解S參數

• 利用S參數提取信息

• 利用S參數 debug

• 反射與TDR

• TDR 分辨率

3、耦合干擾問題

• 同層線間串擾

• 層間串擾

• 孔與孔的耦合干擾

• 回流路徑引起的耦合干擾

• 通過電源系統產生耦合干擾

• 各種耦合干擾的規避措施

4、抖動問題

• 引起抖動的常見因素

• 耦合干擾如何影響抖動

• ISI 如何影響抖動

• AC耦合電容如何影響抖動

• 阻抗不連續如何影響抖動

• 參考平面如何影響抖動

• 電源噪聲如何影響抖動

• 差分對配置如何影響抖動

• 差分不對稱性影響抖動

5、差分、共模的轉換

• 詳解模態轉換

• 模態轉換對眼圖質量的影響

• 解決模態轉換問題的各種措施

6、互連通道阻抗優化

• 阻抗連續性優化內容

• 過孔研究及優化

• 金手指焊盤特性及優化

• AC耦合電容焊盤優化

7、電源優化設計

• 摸透磁珠濾波器的脾氣

• L型還是PI型

• 負載之間的電源干擾

• 優化電源樹結構

• 電源樹優化示例

• SERDES接口模擬電源設計要點

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